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Etude et développement d'optimisation de type simulation par cycle dans le simulateur SMASH (H/F)

  • Type de contrat : Stage
  • Poste basé à : Meylan

Description

Basé en région grenobloise, le stage proposé s’intègre au sein de l’équipe MEDAL qui conçoit des solutions logicielles pour la conception de circuits électroniques à signaux mixtes et la génération de mémoires. Nous concevons, développons et commercialisons les progiciels : SLED (pour l’édition de schéma), SMASH (pour la simulation fonctionnelle), SCROOGE (pour l’estimation de consommation d’énergie).

Notre challenge dans l’équipe MEDAL (Missing EDA Links) réside dans l’apport de solutions innovantes, sur Windows et Linux, permettant aux concepteurs en microélectronique de gagner en efficacité et en qualité lors du développement de leurs circuits.

Missions

Intégré dans une équipe projet, avec la méthode Agile Scrum, vous participez à l’ensemble du flot de développement d’une optimisation pour la simulation de circuits logiques (modèles décrits avec les langages Verilog et VHDL) avec le simulateur SMASH.

Dans la simulation logique, l’exécution du code des modèles affecte des signaux. Le changement de valeur de ces signaux peut redéclencher l’exécution du code des modèles. Cette mécanique pouvant se répéter, il s’agit d’un flot relativement lent.
L’objectif de ce stage consiste à optimiser ce flot pour accélérer la vitesse de simulation d’un ordre de grandeur. La solution envisagée est la transformation de certaines chaînes de déclenchements par des séquences simples et efficaces d’opérations sans dépendances.

Plusieurs missions vous seront donc confiées :

  • La spécification de cas où cette transformation est possible et le développement de leur détection
  • La transformation elle-même, en respectant nos procédures (qualités et en particulier notre processus logiciel : spécification, conception, implémentation, validation, non-régression, documentation, beta-test, livraison).

Vous réaliserez ces développements en utilisant le langage C, en vous appuyant sur des bibliothèques de manipulation d’arbres syntaxiques. Votre challenge est de fournir une solution logicielle fonctionnelle et performante qui sera intégrée dans une nouvelle révision du produit SMASH, et qui soit modulable pour permettre facilement la configuration et l’extension de cas à transformer.

Profil

Vous êtes étudiant ingénieur 3ème année ou Master 2 en informatique.

Vous avez des connaissances en :

  • Langage C / C ++
  • Langage Verilog / VHDL

Aptitudes et qualités :

  • Travail d’équipe
  • Esprit de synthèse
  • Autonomie
  • Soucis de la qualité

Langues : Anglais maîtrisé

Envoyez votre CV et une lettre de motivation à careers@dolphin.fr